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龙图腾网获悉上海创景信息科技股份有限公司申请的专利FPGA通信模块的仿真集成方法及系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120893370B 。

龙图腾网通过国家知识产权局官网在2026-05-08发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511394281.8，技术领域涉及：G06F30/343；该发明授权FPGA通信模块的仿真集成方法及系统是由王耀林;秦炜设计研发完成，并于2025-09-28向国家知识产权局提交的专利申请。

本FPGA通信模块的仿真集成方法及系统在说明书摘要公布了：本发明提供了一种FPGA通信模块的仿真集成方法及系统，包括如下步骤：步骤S1：将FPGA通信模块的IP源码转换为C++语言的FPGA仿真模块代码；步骤S2：基于FPGA仿真模块代码，对全数字仿真系统中访问FPGA通信模块的系统总线访问部分进行接口适配；步骤S3：引入另一个与FPGA通信模块完全相同的模块作为对称模块，将对称模块与FPGA通信模块进行收发接口交叉相连；步骤S4：在对称模块的通信数据接收侧，按照全数字仿真系统中的总线访问方式进行接口适配。本发明的FPGA模块仿真是以FPGA的源码为基础从而提高了FPGA仿真行为的准确性。

本发明授权FPGA通信模块的仿真集成方法及系统在权利要求书中公布了：1.一种FPGA通信模块的仿真集成方法，其特征在于，包括如下步骤： 步骤S1：将FPGA通信模块的IP源码转换为C++语言的FPGA仿真模块代码； 步骤S2：基于FPGA仿真模块代码，对全数字仿真系统中访问FPGA通信模块的系统总线访问部分进行接口适配； 步骤S3：引入另一个与FPGA通信模块完全相同的模块作为对称模块，将对称模块与FPGA通信模块进行收发接口交叉相连； 步骤S4：在对称模块的通信数据接收侧，按照全数字仿真系统中的总线访问方式进行接口适配； 所述步骤S1具体包括如下步骤： 步骤S1.1：分析验证FPGA通信模块的IP源码，从IP源码中提取出顶层模块接口，顶层模块接口包括时钟与复位接口、系统总线接口及通信总线接口； 步骤S1.2：基于提取的顶层模块接口，将FPGA通信模块的IP源码转换为C++语言的FPGA仿真模块代码，C++语言的FPGA仿真模块代码中提供包含所有顶层模块接口的FPGA仿真模型类； 步骤S1.3：编译C++语言的FPGA仿真模块代码，生成FPGA通信模块的静态链接库； 所述步骤S2具体包括如下步骤： 步骤S2.1：实例化步骤S1.2中的FPGA通信模块； 步骤S2.2：针对实例化的FPGA通信模块，定义总线接口信号的数据，总线接口信号的数据包括步骤S1.1中的时钟与复位接口、系统总线接口及通信总线接口； 步骤S2.3：按照全数字仿真系统的总线接口类型的操作说明操作总线接口信号的数据进行变化，模拟总线的读写操作，完成系统总线访问部分的接口适配； 所述步骤S3具体包括如下步骤： 步骤S3.1：实例化一个与步骤S2.1中的FPGA通信模块完全相同的模块，作为对称模块； 步骤S3.2：将步骤S2.1中的FPGA通信模块的数据发送端与步骤S3.1中的对称模块的数据接收端相连，同时将步骤S2.1中的FPGA通信模块的数据接收端与步骤S3.1中对称模块的数据发送端相连，实现两者收发接口的交叉连接； 所述步骤S4具体包括如下步骤： 步骤S4.1：当步骤S2.3中对FPGA通信模块完成总线写操作后，时钟延时预设时间，再按照全数字仿真系统的总线接口类型的操作说明，对步骤S3.1中的对称模块的数据总线接口部分执行读操作，通过该读操作获取总线写操作对应的操作数据，完成对称模块接收侧写操作相关的接口适配； 步骤S4.2：当按照全数字仿真系统的总线接口类型的操作说明，对步骤S3.1中的对称模块的数据总线接口部分执行写操作后，时钟延时预设时间，再按照步骤S2.3的总线访问方式对步骤S2.1中的FPGA通信模块执行读操作，完成对称模块接收侧写操作对应FPGA模块读操作的接口适配。

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